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비휘발성 메모리(NVM) IP 설계와 전력 관리 반도체(PMIC) 분야를 중심으로 SoC용 핵심 회로 기술을 연구하고 있습니다. 로직 공정 기반의 eFuse OTP, EEPROM, MTP 메모리 IP의 저면적 및 고신뢰성 설계 최적화를 통해 자동차 및 모빌리티 산업에 필요한 고속 메모리 시스템 기술을 개발합니다. 또한 CMOS 기반 방사선 센서와 신호 처리 회로 설계를 통해 센서 반도체의 성능을 고도화하고 있습니다. 최근에는 eFLASH 기반 PIM 시냅스 어레이 및 인공신경망 하드웨어를 위한 구동 회로 연구에 주력하며 뉴로모픽 컴퓨팅 구현을 위한 반도체 기술 혁신을 이끌고 있습니다.
| 연구자 프로필 |  |
| 연구자 명 | 김영희 |
| 직책 | 교수 |
| 이메일 | youngkim@changwon.ac.kr |
| 재직 상태 | 재직 중 |
| 부서 학과 |
| 전기전자제어공학부 |
| 사무실 번호 | 055-213-3654 |
| 연구실 | 반도체설계연구실 |
| 연구실 홈페이지 | - |
| 홈페이지 | https://www.changwon.ac.kr/electron/stf/stfView/staffView.do?rolecd=TSAL&staffTy=EXCP&mi=6054 |
| 소속 | 국립창원대학교 |
| 회사명 | 현대전자 (현 SK하이닉스) |
| 재직기간 | 1989.01.01 ~ 2001.02.28 |
| 담당업무 | 메모리 연구개발 부문 책임연구원으로 재직하며 상용 메모리 소자 및 시스템 개발을 주도했습니다. 특히 저전압 DRAM 및 비휘발성 메모리 아키텍처 설계를 담당하여 반도체 메모리의 전력 효율성을 극대화했으며, 당시 축적한 실무 경험은 현재 임베디드 메모리 IP 연구의 기술적 토대가 되었습니다. 다양한 상용화 프로젝트를 수행하며 고집적 메모리의 신뢰성 문제를 해결하는 독자적인 회로 기법을 다수 고안했습니다. |
| 회사명 | 국립창원대학교 |
| 재직기간 | 2001.03.01 ~ 재직 중 |
| 담당업무 | 전자공학과 교수로서 반도체 설계 연구실을 이끌며 시스템 반도체 핵심 IP 개발과 차세대 공학 인재 양성에 매진하고 있습니다. 차세대 모빌리티용 고신뢰 메모리 시스템 개발 및 첨단 방위산업 소재부품 연구실 프로젝트 등 대규모 국책 사업의 책임자로서 산업계 맞춤형 기술 표준을 정립했습니다. 산학협력을 통해 팹리스 기업들이 필요로 하는 로직 공정 호환형 메모리 솔루션을 제공하며 국가 반도체 경쟁력 강화에 기여하고 있습니다. |
| 연구 1 | 로직 공정 호환형 고신뢰성 임베디드 비휘발성 메모리(eNVM) IP 설계 기술 |
| 내용 | 표준 CMOS 로직 공정에서 추가 마스크 없이 구현 가능한 eFuse OTP, EEPROM, MTP 메모리 설계 기술을 연구합니다. BCD 공정을 기반으로 저면적·저전력 특성을 확보함과 동시에 Automotive용 MTP IP에 필수적인 ECC 알고리즘과 Differential Sensing 기술을 도입하여 가혹한 동작 환경에서도 데이터 무결성을 보장하는 고신뢰성 솔루션을 개발했습니다. 이는 모빌리티용 반도체의 데이터 안정성을 확보하는 핵심 기술입니다. |
| 연구 2 | 인공지능 가속을 위한 eFlash 기반 PIM(Processing-In-Memory) 아키텍처 연구 |
| 내용 | 폰 노이만 구조의 데이터 전송 병목 현상을 해결하기 위해 eFlash 기반의 PIM 시냅스 어레이 및 인공신경망 하드웨어 연산 가속 회로를 설계합니다. 하이브리드 본딩 기술을 활용한 TFT eFlash 기반 시냅스 구동 회로를 독자적으로 고안하여 연산 정밀도와 에너지 효율을 극대화했으며, 이를 통해 엣지 컴퓨팅 기기에서 저전력으로 딥러닝 추론이 가능한 반도체 아키텍처를 구현하고 있습니다. 해당 기술은 차세대 뉴로모픽 반도체의 기반이 됩니다. |
| 담당 업무 | 1. 반도체소자: PN 접합, BJT, MOSFET의 물리적 동작 원리와 전하 수송 메커니즘을 심층 분석합니다. 2. 고급전자회로: 아날로그 증폭기, 필터, 데이터 변환기 등 복잡한 혼성 신호 회로의 해석 및 설계 기법을 다룹니다. 3. VLSI시스템설계: 초고집적 회로 설계 방법론과 Cadence 등 EDA 툴을 활용한 레이아웃 설계 및 검증 실습을 진행합니다. 4. 고집적회로설계: 메모리 및 로직 소자의 스케일링 이슈와 최신 나노 공정에서의 물리적 제약 해결 방안을 고찰하며 차세대 메모리 구조를 학습합니다. |
| 활동 내용 | [자문] 과학기술정보통신부 반도체 설계검증 인프라 활성화 사업 자문위원(2023)으로 활동하며 대학 내 반도체 설계 인력 양성을 위한 MPW 서비스 지원 전략을 수립했습니다. [학술] 한국정보전자통신기술학회(KIIECT) 이사 및 대한전자공학회(IEEK) 협력이사로 역임하며 국내 반도체 학계의 기술 교류와 학술적 성장을 주도하고 있습니다. [수상] 2020년 한국정보전자통신기술학회 우수논문상을 수상하며 임베디드 메모리 설계 분야의 독보적인 연구 성과를 대외적으로 인정받았습니다. |
| 학력 사항 | 경북대학교 전자공학과 학사(1989) 포항공과대학교 전자전기공학 석사(1997) 포항공과대학교 전자전기공학 박사(2000) |
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